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シリコンを積層にすると宇宙線の当たる確立が飛躍的に増えそうな気がするんだけどどうなんでしょ?教えてエロい人!
シリコンの厚みが増えるので積層数に比例してエラー率は高くなります。
今回のメモリは64bitにつき1bit訂正、2bitエラー検出を行ってますね。
積層したメモリに発生するエラーを記録していくと宇宙線の入射方向がわかって電波望遠鏡になったりしてデータセンタのエラーログで超新星爆発を観測しよう!
エロくないけど、シリコンに宇宙線の当たる(エネルギーをシリコン内に残していく)確率は主にシリコンの体積に比例するので横に並べようが縦に並べようが体積が一緒なら飛躍的に増える、ということはないのでは。
チップ単位で死ぬこともあるので、そういう故障耐性はChipkill [wikipedia.org]とかSSDCとかExtended ECCとか、チップを跨いでエラー訂正する技術で対処するのが今時のRAS技術としては当たり前だと思います。TSV使ったメモリチップでも同じ原理で行けると思いますよ。
リンク先に書いてあるけど、BCHとか使ってるの?複数ビット訂正だとレイテンシが短くできないのでは?
144, 128のS4EC-D4EDのパリティ行列は、10年位前にすでに特許出願後20年たってたなあ。
おそらく単純なハミング符号ですね。BCHだと遅くなりすぎます。
×確立
# エロい人っていう言い回しも、素で「?」ってなる方がそろそろ多数派かも…。
それを言うと、そもそも、教えてエラい人 、って言い回しの元ネタを知っている人が少数なのでは?
#最近、朝にやってるシャキーンがウゴウゴルーガっぽいと思ってる
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「毎々お世話になっております。仕様書を頂きたく。」「拝承」 -- ある会社の日常
宇宙線 (スコア:0)
シリコンを積層にすると宇宙線の当たる確立が飛躍的に増えそうな気がするんだけどどうなんでしょ?
教えてエロい人!
Re:宇宙線 (スコア:2)
シリコンの厚みが増えるので
積層数に比例してエラー率は高くなります。
今回のメモリは64bitにつき1bit訂正、2bitエラー検出を
行ってますね。
-- 風は東京に吹いているか
Re:宇宙線 (スコア:1)
積層したメモリに発生するエラーを記録していくと宇宙線の入射方向がわかって電波望遠鏡になったりして
データセンタのエラーログで超新星爆発を観測しよう!
Re: (スコア:0)
エロくないけど、シリコンに宇宙線の当たる(エネルギーをシリコン内に残していく)確率は
主にシリコンの体積に比例するので横に並べようが縦に並べようが体積が一緒なら
飛躍的に増える、ということはないのでは。
Re: (スコア:0)
Re:宇宙線 (スコア:1)
チップ単位で死ぬこともあるので、そういう故障耐性はChipkill [wikipedia.org]とかSSDCとかExtended ECCとか、
チップを跨いでエラー訂正する技術で対処するのが今時のRAS技術としては当たり前だと思います。
TSV使ったメモリチップでも同じ原理で行けると思いますよ。
Re: (スコア:0)
リンク先に書いてあるけど、BCHとか使ってるの?
複数ビット訂正だとレイテンシが短くできないのでは?
144, 128のS4EC-D4EDのパリティ行列は、10年位前にすでに
特許出願後20年たってたなあ。
Re:宇宙線 (スコア:1)
おそらく単純なハミング符号ですね。
BCHだと遅くなりすぎます。
-- 風は東京に吹いているか
Re: (スコア:0)
×確立
# エロい人っていう言い回しも、素で「?」ってなる方がそろそろ多数派かも…。
Re: (スコア:0)
それを言うと、そもそも、
教えてエラい人 、って言い回しの元ネタを知っている人が少数なのでは?
#最近、朝にやってるシャキーンがウゴウゴルーガっぽいと思ってる