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TLBを実装して使える場所は色々ありますが、今回は3rdキャッシュのTLBでMMU(Pageing)とは別のとこのTLBの話ですよ。
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長期的な見通しやビジョンはあえて持たないようにしてる -- Linus Torvalds
TLBエラッタえらいこっちゃ (スコア:1, 興味深い)
MMU付きのCPUの場合はほとんどTLBを持っておりまして、論物変換を高速に引くためにTLBを使っていますんで。
で、TLBがミスヒットしたらアドレス解決するために、計算したりメモリ読んだりしないといけないです。
これを回避ということは、わざわざTLBクリーンしていたとかそういうことなのでしょうかね。
それともALLMiss状態。。。恐ろしや。
マルチコアだとCPUでのキャッシュの扱いとか、MMUの整合性処理が大変そうですね。。。
Re: (スコア:0)
TLBを実装して使える場所は色々ありますが、今回は3rdキャッシュのTLBでMMU(Pageing)とは別のとこのTLBの話ですよ。
Re: (スコア:0)
ただ、バグが出る条件として L3 キャッシュがからんでいたので、
ページテーブルに関してはキャッシュ不能にして回避って話じゃ
ありませんでした?
なんかさっき書いたコメントが書き込まれてなかった。どうでもいいが。 (スコア:1)
Re:なんかさっき書いたコメントが書き込まれてなかった。どうでもいいが。 (スコア:0)
他のコメント見ると。
もっと深刻。