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ピン数を増やしたということは、データ転送の並列性が増したということなのでしょうか?大学のコンピュータ系の講義で、「最近の傾向はパラレルからシリアルだ。データ転送速度がかなり速くなってるため、パラレル+データ制御 よりもシリアル通信の方が結局速くなるから。」といった趣旨のお話を伺ったのですが、どうなのでしょう?(ハードディスクがPATAからSATAになってきたのもその流れです)
詳しい人、教えてください。
等長配線はもう古い。等長配線は、いちばん長い配線に揃える、つまり、配線が長くなってしまうという欠点がある。そこでDDR3では、等長配線をやめて最短距離で配線し、遅延時間のバラツキは補正で何とかする。
その他にも、メモリコントローラとDRAMチップ間で、様々な調整を行っている(温度によって特性が変るので、システム動作中にも再調整が行われる)。
とりあえずhttp://ja.wikipedia.org/wiki/DDR3_SDRAM%E3%81%AB%E3%81%8A%E3%81%91%E3%... [wikipedia.org]あたりを見てください。
おぉ、RambusのFlexPhaseのような技術が既にDDR3でも使われてたんだ。リード/ライトレベリングと言うんですね。何だか自分が思って以上にJEDEC系のメモリも発展していますね。
#まあSDカード程度なら等長配線の方が安上がりかと。
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ピン数増=パラレル化? (スコア:1)
ピン数を増やしたということは、データ転送の並列性が増したということなのでしょうか?
大学のコンピュータ系の講義で、「最近の傾向はパラレルからシリアルだ。データ転送速度がかなり速くなってるため、パラレル+データ制御 よりもシリアル通信の方が結局速くなるから。」といった趣旨のお話を伺ったのですが、どうなのでしょう?
(ハードディスクがPATAからSATAになってきたのもその流れです)
詳しい人、教えてください。
Re: (スコア:1)
Re:ピン数増=パラレル化? (スコア:1, 参考になる)
等長配線はもう古い。
等長配線は、いちばん長い配線に揃える、つまり、配線が長くなってしまうという欠点がある。
そこでDDR3では、等長配線をやめて最短距離で配線し、遅延時間のバラツキは補正で何とかする。
その他にも、メモリコントローラとDRAMチップ間で、様々な調整を行っている(温度によって特性が変るので、システム動作中にも再調整が行われる)。
とりあえず
http://ja.wikipedia.org/wiki/DDR3_SDRAM%E3%81%AB%E3%81%8A%E3%81%91%E3%... [wikipedia.org]
あたりを見てください。
Re:ピン数増=パラレル化? (スコア:1)
おぉ、RambusのFlexPhaseのような技術が既にDDR3でも使われてたんだ。リード/ライトレベリングと言うんですね。何だか自分が思って以上にJEDEC系のメモリも発展していますね。
#まあSDカード程度なら等長配線の方が安上がりかと。